Detalhes da linha de CPU EPYC Genoa Server de próxima geração da AMD, que apresentará a arquitetura Zen 4 core, vazaram por ExecutableFix . Os detalhes apontam várias especificações para a próxima linha e a respectiva plataforma SP5 que sucederá a plataforma SP3 existente da AMD, que durou três gerações de CPUs EPYC, incluindo Nápoles, Roma e a próxima, Milão.

Detalhes da CPU do servidor AMD EPYC Genoa Vazamento-Enorme 96 Zen 4 núcleos em até 12 chips, suporte DDR5/PCIe 5, soquete LGA 6096

Ouvimos alguns boatos sobre o EPYC Genoa da AMD no passado, mas parece que o último tweet de ExecutableFix revela o maior lançamento de EPYC até agora. A AMD mudará para uma nova plataforma e apresentará tantos recursos novos que cada um deles merece uma menção especial. A linha de Gênova deve ser lançada ainda este ano, com um lançamento difícil por volta de 2022.

Começando pelos detalhes, a AMD já anunciou que o EPYC Genoa seria compatível com a nova plataforma SP5 que traz um novo soquete para que a compatibilidade com o SP3 existisse até o EPYC Milan. Os processadores EPYC Genoa também apresentariam suporte para nova memória e novos recursos. Nos últimos detalhes, é relatado que a plataforma SP5 também contará com um novo soquete que contará com 6096 pinos dispostos no formato LGA (Land Grid Array). Este será de longe o maior soquete que a AMD já projetou, com mais 2002 pinos do que o soquete LGA 4094 existente.

O soquete suportará EPYC Genoa da AMD e futuras gerações de chips EPYC. Falando sobre as próprias CPUs Gênova, os chips vão empacotar 96 núcleos e 192 threads. Eles serão baseados na nova arquitetura de núcleo Zen 4 da AMD, que deve fornecer alguns aumentos insanos de IPC ao utilizar o nó de processo TSMC 5nm. A boato recente apontou que as CPUs AMD EPYC Genoa devem oferecer até 29% de elevação IPC em relação às CPUs Milan e uma melhoria geral de 40% graças a outras tecnologias importantes que iremos abordar daqui a pouco.

Para chegar a 96 núcleos, a AMD precisa embalar mais núcleos em seu pacote de CPU EPYC Genoa. Diz-se que a AMD conseguiu isso incorporando um total de até 12 CCDs em seu chip Gênova. Cada CCD terá 8 núcleos baseados na arquitetura Zen 4. Isso se alinha com o aumento do tamanho do soquete e poderíamos estar olhando para um mediador de CPU massivo, ainda maior do que os CPUs EPYC existentes. Diz-se que a CPU apresenta TDPs de 320 W, que podem ser configurados em até 400 W.

Essa é uma área que teve um grande aumento. As peças de topo atuais chegam a 280W TDPs, então um TDP de 400W é insanos 120W a mais do que o Milan. Mas, considerando o desempenho aprimorado e as contagens de núcleo, podemos definitivamente esperar uma eficiência de alto nível para Gênova. Ao mesmo tempo, também podemos esperar velocidades de clock mais rápidas, especialmente as frequências básicas que poderiam se beneficiar diretamente do TDP aumentado. O dado IO será separado dos CCDs e isso aumentará a contagem total de chips no chip para 13.

Fora isso, afirma-se que os CPUs EPYC Genoa da AMD terão 128 pistas PCIe Gen 5.0, 160 para uma configuração 2P (soquete duplo). A plataforma SP5 também contará com suporte de memória DDR5-5200, que é uma melhoria insana em relação aos DIMMs DDR4-3200 MHz existentes. Mas isso não é tudo, ele também suporta até 12 canais de memória DDR5 e 2 DIMMs por canal, o que permite até 3 TB de memória do sistema usando módulos de 128 GB.

O principal concorrente da linha EPYC Genoa da AMD seria o alvo Família Sapphire Rapids Xeon da Intel , que deve ser lançado em 2022 também com suporte a memória PCIe Gen 5 e DDR5. Recentemente, houve rumores de que a programação não teria um aumento de volume até 2023, sobre a qual você pode ler mais aqui. No geral, a linha de Gênova da AMD parece estar em ótima forma após esse vazamento e pode ser uma grande interrupção para o segmento de servidores se a AMD jogar suas cartas até o lançamento de Gênova.

A postagem Plataforma de CPU AMD EPYC Genoa detalhada-até 96 Zen 4 Cores, 192 Threads, 12 canais DDR5-5200, 128 PCIe Gen 5 Lanes, SP5’LGA 6096’Socket de Hassan Mujtaba apareceu primeiro em Wccftech .

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