A Taiwan Semiconductor Manufacturing Company Limited (TSMC) aprovou US $ 9 bilhões em despesas de capital ontem, já que pretende se concentrar simultaneamente no desenvolvimento de seus processos de fabricação de semicondutores mais recentes e maduros. A TSMC, que é a maior fabricante mundial de chips terceirizados, está atualmente expandindo agressivamente sua capacidade de fabricação por meio da construção de novas fundições em Taiwan, Estados Unidos e Japão. Espera-se que eles sejam fabricados usando tecnologias de chip avançadas e maduras, e alguns dos US $ 9 bilhões aprovados pelo conselho da empresa irão para esses propósitos.
A TSMC aumentará a capacidade de fabricação de chips e construirá novas fábricas com gastos de capital de US $ 9 bilhões Apropriação
O roteiro atual do processo de fabricação de semicondutores da TSMC envolve a fabricação de seus produtos por meio de 3 nanômetros (nm) de ponta durante o segundo semestre do próximo ano, com a produção experimental desse processo prevista para começar em breve.
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No momento, seu principal processo de fabricação é o nó de 5nm, que consiste em vários famílias de processos, sendo a última o nó N4P. Este nó, de acordo com a empresa, é o terceiro refinamento da família de processos de 5 nm e traz 22% de eficiência de energia e 11% de ganhos de desempenho em relação ao nó N5 ou nó de 5 nm da primeira geração.
Os US $ 9 bilhões O conselho da TSMC aprovou despesas de capital em uma reunião realizada na segunda-feira, e os detalhes descrevem que esses fundos serão usados para:
Aprovadas apropriações de capital de aproximadamente US $ 9.036,44 milhões (aproximadamente NT $ 239.464,84 milhões) para os propósitos incluindo: 1) Instalação e atualização de capacidade de tecnologia avançada; 2) Instalação de capacidade de tecnologia madura e especializada; 3) Instalação de capacidade de embalagem avançada; 4) Construção fabulosa, instalação de sistemas de instalação fab e ativos arrendados capitalizados; 5) Investimentos de capital em P&D no primeiro trimestre de 2022 e despesas de capital de sustentação.
Alguns dos projetos de construção da TSMC incluem uma fábrica de chips de 2 nm em Taiwan, uma fábrica de 5 nm no Arizona, Estados Unidos e outra instalação de 5 nm em Taiwan. Além disso, a empresa também firmou uma joint venture japonesa para uma fábrica de 22/28 nm no país por meio de um investimento de capital de US $ 2 bilhões.
O relatório de receita da TSMC para outubro de 2021 revela essa receita acumulada no ano cresceu 17%. Imagem: TSMC
Um dia depois de sua diretoria aprovar os planos de gastos, a TSMC também divulgou seu relatório de receitas para o mês de outubro. Os detalhes revelam que a empresa gerou NT $ 134 bilhões em receita durante o mês, representando um crescimento anual de cerca de 13%. No entanto, sequencialmente, a receita caiu 11,9%, caindo em NT $ 18 bilhões.
Nos dez meses de 2021, a receita da TSMC foi de NT $ 1,28 trilhão, uma vez que cresceu 17% ao longo do ano até a data Receita de outubro para 2020. A queda sequencial ocorre depois que rumores de Taiwan sugeriram que a empresa deve fazer uma correção de estoque, já que a indústria de semicondutores se prepara para uma redução da demanda na esteira da escassez histórica e do crescimento da capacidade.
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Esses rumores, que surgiram em setembro, preocupavam que o crescimento da TSMC para o último trimestre deste ano pudesse ser cortado pela metade devido a cortes de pedidos de 5nm e Modems de smartphone 7nm projetados para se conectar a redes celulares de quinta geração (5G).
Os cortes devem reduzir o crescimento da receita da TSMC durante o quarto trimestre para 5%, e eles acompanharam em um debate na comunidade financeira sobre TSMC’sendo capaz de aumentar suas margens brutas 50%. Na terminologia financeira, a margem bruta se refere à relação entre a receita de despesas diretas de uma empresa e sua receita geral, e um valor mais alto reflete melhores eficiências de custo.
Essas eficiências, acreditam alguns, resultarão do nó de 3 nm , que usa uma quantidade maior de luz ultravioleta na fabricação de chips. Em seu lançamento N4P, a TSMC teve o cuidado de mencionar que o nó”diminui a complexidade do processo e melhora o tempo de ciclo do wafer ao reduzir o número de máscaras”, o que, por sua vez, acaba reduzindo os custos diretos de fabricação de um wafer de silício.
