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O sucessor do EPYC da AMD As CPUs Turin, que contarão com núcleos Zen 5, serão chamadas de EPYC Venice e contarão com arquitetura Zen 6, relata A lei de Moore está morta.

CPUs do servidor AMD EPYC Venice devem apresentar mais de 200 núcleos Zen 6 com cache L2/L3 redesenhado e SKUs HBM

Embora os detalhes sejam bastante vago no momento, considerando que este produto não deve ser lançado até 2025+, parece que o MLID colocou as mãos em detalhes muito iniciais sobre o codinome e o marketing da AMD surgiu com’Veneza’para sua linha EPYC de próxima geração. Com o nome da capital da região de Veneto, no nordeste da Itália, espera-se que a linha EPYC Venice seja uma grande atualização para servidores.

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Alguns detalhes compartilhados incluem referências aos núcleos AMD Zen 6, embora não se saiba se a equipe vermelha continuará com seu esquema de nomenclatura Zen após 2025 ou mudará para outra coisa. O segmento do servidor continuará com a convenção de nomenclatura EPYC. Diz-se que o Zen 6 ou a arquitetura x86 após o Zen 5 fará uso de uma abordagem de design de núcleo muito híbrida e pode oferecer mais de 200 núcleos (uma estimativa conservadora) com rumores de até 384 núcleos por soquete. Não há menção se a CPU será compatível com a plataforma SP5, mas parece que Turin e seu acompanhamento no Zen 5C podem ser os últimos chips EPYC para a próxima plataforma. O soquete SP5 durará até 2025, o que é um bom prazo para fornecer uma atualização.

Quanto às atualizações na própria arquitetura, o vazador também afirmou que a AMD deve redesenhar completamente o sistema de cache L2 e L3. A arquitetura Infinity Cache também sofrerá uma grande mudança. Além disso, o HBM se tornará o padrão na maior parte da linha e o padrão de memória desempenhará um papel importante nas CPUs EPYC de próxima geração. O design híbrido HBM integrado ao EPYC pode ser usado para dimensionar o IPC dentro da mesma contagem de núcleos. Um detalhe interessante e importante é que Tom também espera que as ofertas EPYC baseadas em Zen 5 estejam entre os primeiros produtos de servidor AMD EPYC a apresentar designs HBM, enquanto o EPYC Venice irá padronizá-lo em vários SKUs.

No final, embora tudo isso pareça ótimo, lembre-se de que estamos falando de produtos que serão lançados daqui a 3-4 anos e muita coisa pode mudar nesse meio tempo. Mas parece que o EPYC Venice da AMD pode realmente ser uma coisa e mal podemos esperar para vê-lo em ação daqui a alguns anos!

Famílias de CPU AMD EPYC:

Nome da famíliaAMD EPYC NaplesAMD EPYC RomeAMD EPYC MilanAMD EPYC Milan-XAMD EPYC GenoaAMD EPYC BergamoAMD EPYC Turin Family BrandingEPYC 7001EPYC 7002EPYC 7003EPYC 7003X?EPYC 7004?EPYC 7005?EPYC 7006? Lançamento da família2017201920212022202220232024-2025? Arquitetura da CPUZen 1Zen 2Zen 3Zen 3Zen 4Zen 4CZen 5 Processo Node14nm GloFo7nm TSMC7nm TSMC7nm TSMC5nm TSMC5nm TSMC3nm TSMC? Plataforma NameSP3SP3SP3SP3SP5SP5SP5 SocketLGA 4094LGA 4094LGA 4094LGA 4094LGA 6096LGA 6096LGA 6096 Max Núcleo Count3264646496128256 Max Passe Count64128128128192256512 Max L3 Cache64 MB256 MB256 MB768 MB? 384 MB? Do TBDTBD Chiplet Design4 CCD (2 de per CCD CCX) + 1 IOD8 CCD 8 de CCD (2 de per CCD CCX) de ( 1 CCX por CCD) + 1 IOD8 CCDs com 3D V-Cache (1 CCX por CCD) + 1 IOD12 CCDs (1 CCX por CCD) + 1 IOD12 CCDs (1 CCX por CCD) + 1 IODTBD Memory SupportDDR4-2666DDR4-3200DDR4-3200DDR4-3200DDR5-5200DDR5-5600?DDR5-6000? Memory Channels8 Channel8 Channel8 Channel8 Channel12 Channel12 ChannelLeltBD PCIE Gen Suporte64 Gen 3128 Gen 4128 Gen 4128 Gen 4128 Gen 5TBDTBD TDP RANGE200W280W280W280W320W (CTDP 400W) 320W (CTDP 400) 48 WTDP80W (CTDP) 320W280W280W280W (CTDP 400W) 320W (CTDPP) Há rumores de que as CPUs Turin, que contarão com núcleos Zen 5, serão chamadas de EPYC Venice e contarão com a arquitetura Zen 6, relata a Lei de Moore está morta. Rumores de que as CPUs do servidor AMD EPYC Venice apresentarão mais de 200 núcleos Zen 6 com cache L2/L3 redesenhado e SKUs HBM Enquanto os detalhes são […]

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